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• Vivado Design Suite を使用したArtix-7 FPGA設計・開発入門
• Vivado Design Suite でのFPGA設計導入
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• Vivado Design Suite を使用したIPの管理
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• UltraScale アーキテクチャ FPGA デザイン

• XILINX FPGA向けRTL設計スタイルガイドセミナー
• [Verilog] XILINX/Vivadoツールを使ったRTL設計初級
• [VHDL] XILINX/Vivadoツールを使ったRTL設計初級
• Vivado Design Suite を使用したシミュレーション

• ISE FPGA設計導入
• ISE FPGA設計実践

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• Cコード ベースの設計 : Vivado HLx を使用した高位合成

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• SDKユーザのためのVITIS
• VITISでのエンベデッドシステムソフトウェア開発
• ARTYを使用したMicroBlaze開発入門
• Zynq SoC システムアーキテクチャ
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• PetaLinuxツールを使用したエンベデッド デザイン

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• PCI Express デザイン

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• Kria KV260 Vision AI
• Versal AI Engine 1: アーキテクチャとデザインフロー
• Versal AI Engine 2: AI エンジンカーネルを使ったグラフプログラミング
• Versal ACAP: ネットワーク オン チップ
• Versal ACAP: アーキテクチャとメソドロジー１
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• Vitis HLSを使った高位合成
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• Zynq UltraScale+ MPSoC ｼｽﾃﾑｱｰｷﾃｸﾁｬ
• Zynq UltraScale+ MPSoC ハードウェアデザイン
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• Zynq UltraScale+ MPSoC VCU を使ったマルチメディアソリューション

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• System Generator を使用したDSPデザイン
• Vivado Design Suite での大規模デザインの設計手法
• 7 シリーズ FPGA デザイン
• [入門] C/C++ によるSDSoC開発環境
• [実践] C/C++ によるSDSoC開発環境と設計手法
• 高速メモリインターフェイスデザイン
• マルチギガビットシリアルI/Oを使用した設計

• XILINX/Vivado HLSツールを使ったC言語入門